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Layout Versus Schematic

См. также в других словарях:

  • Layout Versus Schematic — (LVS) ist ein Schritt bei der Layoutverifikation von integrierten Schaltkreisen, um die Übereinstimmung des erzeugten Layouts mit der ursprünglichen Schaltung (Schematic) sicherzustellen. Dazu wird die bei der Layoutsynthese benutzte originale… …   Deutsch Wikipedia

  • Layout Versus Schematic — The Layout Versus Schematic (LVS) is the class of electronic design automation (EDA) verification software that determines whether a particular integrated circuit layout corresponds to the original schematic or circuit diagram of the design.… …   Wikipedia

  • Integrated circuit layout — Integrated circuit layout, also known IC layout, IC mask layout, or mask design, is the representation of an integrated circuit in terms of planar geometric shapes which correspond to the patterns of metal, oxide, or semiconductor layers that… …   Wikipedia

  • Electronic design automation — (EDA) is the category of tools for designing and producing electronic systems ranging from printed circuit boards (PCBs) to integrated circuits. This is sometimes referred to as ECAD (electronic computer aided design) or just CAD. (Printed… …   Wikipedia

  • Conception de circuits intégrés — La conception (ou le design) de circuits intégrés (ou puces électroniques) consiste à réaliser les nombreuses étapes de développement (flot de conception ou design flow) nécessaires pour concevoir correctement et sans erreurs une puce… …   Wikipédia en Français

  • Conception De Circuits Intégrés — La conception (ou le design) de circuits intégrés (ou puces électroniques) consiste à réaliser les nombreuses étapes de développement (flot de conception ou design flow) nécessaires pour concevoir correctement et sans erreurs une puce… …   Wikipédia en Français

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  • Standard cell — For the battery used as a voltage reference, see Weston cell. In semiconductor design, standard cell methodology is a method of designing Application Specific Integrated Circuits (ASICs) with mostly digital logic features. Standard cell… …   Wikipedia

  • Leiterplattenlayout — Unter Layoutentwurf einer elektronischen Schaltung (Schaltkreis, Multi Chip Modul, Leiterplatte) versteht man das Erstellen und die Verifikation der geometrischen Anordnung der Zellen bzw. Bauelemente und ihrer Verbindungen. Die Verifikation… …   Deutsch Wikipedia

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